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DDR一致性测试基本参数
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DDR 规范的 DC 和 AC 特性

对于任何一种接口规范的设计,首先要搞清楚系统中传输的是什么样的信号,也就是驱动器能发出什么样的信号,接收器能接受和判别什么样的信号,用术语讲,就是信号的DC和AC特性要求。

在DDR规范文件JEDEC79R的第51页[TABLE6:ELECTRICALCHARACTERISTICSANDDCOPERATINGCONDITIONS]中对DDR的DC有明确要求:VCC=+2.5V+0.2V,Vref=+1.25V±0.05V,VTT=Vref±0.04V.

在我们的实际设计中,除了要精确设计供电电源模块之外,还需要对整个电源系统进行PI仿真,而这是高速系统设计中另一个需要考虑的问题,在这里我们先不讨论它,暂时认为系统能够提供稳定的供电电源。

除DC特性外,我们还应该注意规范中提到的AC特性,所谓AC特性,就是信号在高速利转状态下所表现出的动态变化特性。DDR规范中第60页,对外于云态变化的地址信号、控制信号及数据信号分别给出了交流特性的要求。为方便读者,现把规范中对干信号交流特性的要求复制到这里,作为高速系统设计的一部分,要确保在我们的系统中,所有处于高速工作状态下的DDR信号要符合这个AC特性规范。 寻找能够满足您的 DDR 和存储器需求的特定解决方案。广西DDR一致性测试方案商

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RDIMM(RegisteredDIMM,寄存器式双列直插内存)有额外的RCD(寄存器时钟驱动器,用来缓存来自内存控制器的地址/命令/控制信号等)用于改善信号质量,但额外寄存器的引入使得其延时和功耗较大。LRDIMM(LoadReducedDIMM,减载式双列直插内存)有额外的MB(内存缓冲,缓冲来自内存控制器的地址/命令/控制等),在技术实现上并未使用复杂寄存器,只是通过简单缓冲降低内存总线负载。RDIMM和LRDIMM通常应用在高性能、大容量的计算系统中。

综上可见,DDR内存的发展趋势是速率更高、封装更密、工作电压更低、信号调理技术 更复杂,这些都对设计和测试提出了更高的要求。为了从仿真、测试到功能测试阶段保证DDR信号的波形质量和时序裕量,需要更复杂、更的仿真、测试和分析工具。


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对DDR5来说,设计更为复杂,仿真软件需要帮助用户通过应用IBIS模型针对基于 DDR5颗粒或DIMM的系统进行仿真验证,比如仿真驱动能力、随机抖动/确定性抖动、寄 生电容、片上端接ODT、信号上升/下降时间、AGC(自动增益控制)功能、4taps DFE(4抽头 判决反馈均衡)等。

DDR的读写信号分离

对于DDR总线来说,真实总线上总是读写同时存在的。规范对于读时序和写时序的 相关时间参数要求是不一样的,读信号的测量要参考读时序的要求,写信号的测量要参考写 时序的要求。因此要进行DDR信号的测试,第一步要做的是从真实工作的总线上把感兴 趣的读信号或者写信号分离出来。JEDEC协会规定的DDR4总线的 一个工作时 序图(参考资料: JEDEC STANDARD DDR4 SDRAM,JESD79-4),可以看到对于读和写信 号来说,DQS和DQ间的时序关系是不一样的。

软件运行后,示波器会自动设置时基、垂直增益、触发等参数并进行测量,测量结果会 汇总成一个html格式的测试报告,报告中列出了测试的项目、是否通过、spec的要求、实测 值、margin等。

使用自动测试软件的优点如下所述:

•自动化的设置向导避免连接和设置错误;

•快速的测量和优化的算法减少测试时间;

•可以测试JEDEC规定的速率也可以测试用户自定义的数据速率;

•独有的自动读写分离技术简化了测试操作;

•能够多次测量并给出一个统计的结果;

•能够根据信号斜率自动计算建立/保持时间的修正值。 DDR3信号质量测试,信号一致性测试。

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由于DDR4的数据速率会达到3.2GT/s以上,DDR5的数据速率更高,所以对逻辑分析仪的要求也要很高,需要状态采样时钟支持1.6GHz以上且在双采样模式下支持3.2Gbps 以上的数据速率。基于高速逻辑分析仪的DDR4/5协议测试系统。图中是通过 DIMM条的适配器夹具把上百路信号引到逻辑分析仪,相应的适配器要经过严格测试,确 保在其标称的速率下不会因为信号质量问题对协议测试结果造成影响。目前的逻辑分析仪可以支持4Gbps以上信号的采集和分析。DDR4参数测试参考解决方案.测量DDR一致性测试一致性测试

DDR数据总线的一致性测试。广西DDR一致性测试方案商

大部分的DRAM都是在一个同步时钟的控制下进行数据读写,即SDRAM(Synchronous Dynamic Random -Access Memory) 。SDRAM根据时钟采样方式的不同,又分为SDR   SDRAM(Single Data Rate SDRAM)和DDR SDRAM(Double Data Rate SDRAM) 。SDR  SDRAM只在时钟的上升或者下降沿进行数据采样,而DDR SDRAM在时钟的上升和下降 沿都会进行数据采样。采用DDR方式的好处是时钟和数据信号的跳变速率是一样的,因 此晶体管的工作速度以及PCB的损耗对于时钟和数据信号是一样的。广西DDR一致性测试方案商

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河南DDR一致性测试联系人 2025-02-18

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